Bus Mastering

Autor: Laura McKinney
Fecha De Creación: 9 Abril 2021
Fecha De Actualización: 24 Junio 2024
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Contenido

Definición - ¿Qué significa Bus Mastering?

La masterización de bus es una característica de arquitectura de bus que permite que un bus de control se comunique directamente con otros componentes sin tener que pasar por la CPU. La mayoría de las arquitecturas de bus actualizadas, como la interconexión de componentes periféricos (PCI), Soporte de masterización de bus.

La masterización de bus aumenta la velocidad de transferencia de datos del sistema operativo, conserva los recursos del sistema y aumenta el rendimiento y el tiempo de respuesta.


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Techopedia explica Bus Mastering

La masterización de bus permite que un bus de control acceda a la RAM independientemente de la CPU. Está diseñado para permitir la transferencia de datos entre un componente periférico y RAM mientras la CPU implementa otras responsabilidades.

La plataforma maestra del bus se encuentra más comúnmente en distintos dispositivos de entrada / salida (E / S) o en un microprocesador. Dirige el tráfico en una ruta de E / S o en un bus de computadora. El maestro del bus es el "maestro" y controla las rutas del bus que contienen las señales de transmisión y la dirección. Los dispositivos de entrada y salida (E / S) en un bus son los "esclavos".

Si una computadora contiene varios componentes que admiten el dominio del bus, se debe implementar una estructura jerárquica para evitar que varios componentes intenten usar el bus al mismo tiempo. Hay varias estructuras como:


  • Interfaz de sistema de computadora pequeña (SCSI): transfiere datos entre la computadora y los dispositivos periféricos. Incluye una prioridad permanente para cada ID SCSI
  • Interfaz periférica en serie (SPI): funciona en modo dúplex completo (en ambas direcciones) utilizando la arquitectura maestro / esclavo. El dispositivo maestro inicia la trama de datos, que incluye la sincronización de trama.
  • Circuito Inter-Integrado (I2C) Interfaz: tiene una arquitectura de bus serie bidireccional que contiene los bits de parada e inicio, que controlan la transferencia de datos.